Evolutionary Functional Recovery in Virtual Reconfigurable Circuits

Result code in IS VaVaI

<a href="https://www.isvavai.cz/riv?ss=detail&h=RIV%2F00216305%3A26230%2F07%3APU70825" target="_blank" >RIV/00216305:26230/07:PU70825 - isvavai.cz</a>

Result on the web

—

DOI - Digital Object Identifier

—

Result language

angličtina

Original language name

Evolutionary Functional Recovery in Virtual Reconfigurable Circuits

Original language description

A virtual reconfigurable circuit (VRC) is a domain-specific reconfigurable device developed using an ordinary FPGA in order to easily implement evolvable hardware applications. While a fast partial run-time reconfiguration and application-specific programmable elements represent the main advantages of VRC, the main disadvantage of the VRC is the area consumed. This study describes experiments conducted to estimate how the use of VRC influences the dependability of FPGA-based evolvable systems. It is shown that these systems are not as sensitive to faults as their area-demanding implementations might suggest. An evolutionary algorithm is utilized to design fault tolerant circuits as well as to perform an automatic functional recovery when faults are detected in the configuration memory of the FPGA. All the experiments are performed on models of reconfigurable devices.&nbsp;

Czech name

Evolutionary Functional Recovery in Virtual Reconfigurable Circuits

Czech description

Virtuální rekonfigurovatelný obvod (VRC) je speciální rekonfigurovatelné zařízení vytvořené v běžném obvodě typu FPGA s cílem usnadnit implementaci vyvíjejících se obvodů. Zatímco rychlá parciální rekonfigurace a aplikačně specifické výpočetní elementy jsou výhodou VRC, jejich největší nevýhodou je velké množství zdrojů nutných k implementaci v FPGA. Tato studie ukazuje, jak použití VRC ovlivňuje spolehlivost vyvíjejících se systémů v FPGA. Ukazuje se, že tyto vyvíjející se systémy nejsou až tak náchylné k poruchám, jak by jejich vysoká implementační cena mohla evokovat. Evoluční algoritmus je použit pro návrh odolných obvodů a k obnovení činnosti obvodu při poruše. Všechny experimenty byly provedeny na modelech rekonfigurovatelných zařízení.

Type

J_x - Unclassified - Peer-reviewed scientific article (Jimp, Jsc and Jost)

CEP classification

JC - Computer hardware and software

OECD FORD branch

—

Project

<a href="/en/project/GA102%2F06%2F0599" target="_blank" >GA102/06/0599: Methods of polymorphic digital circuit design</a><br>

Continuities

P - Projekt vyzkumu a vyvoje financovany z verejnych zdroju (s odkazem do CEP)<br>Z - Vyzkumny zamer (s odkazem do CEZ)

Publication year

2007

Confidentiality

S - Úplné a pravdivé údaje o projektu nepodléhají ochraně podle zvláštních právních předpisů

Name of the periodical

ACM Journal on Emerging Technologies in Computing Systems

ISSN

1550-4832

e-ISSN

—

Volume of the periodical

3

Issue of the periodical within the volume

2

Country of publishing house

US - UNITED STATES

Number of pages

22

Pages from-to

1-22

UT code for WoS article

—

EID of the result in the Scopus database

—