Vše

Co hledáte?

Vše
Projekty
Výsledky výzkumu
Subjekty

Rychlé hledání

  • Projekty podpořené TA ČR
  • Významné projekty
  • Projekty s nejvyšší státní podporou
  • Aktuálně běžící projekty

Chytré vyhledávání

  • Takto najdu konkrétní +slovo
  • Takto z výsledků -slovo zcela vynechám
  • “Takto můžu najít celou frázi”

Analýza a zlepšení testovatelnosti číslicových obvodů na úrovni meziregistrových přenosů

Identifikátory výsledku

  • Kód výsledku v IS VaVaI

    <a href="https://www.isvavai.cz/riv?ss=detail&h=RIV%2F00216305%3A26230%2F08%3APU76679" target="_blank" >RIV/00216305:26230/08:PU76679 - isvavai.cz</a>

  • Výsledek na webu

  • DOI - Digital Object Identifier

Alternativní jazyky

  • Jazyk výsledku

    čeština

  • Název v původním jazyce

    Analýza a zlepšení testovatelnosti číslicových obvodů na úrovni meziregistrových přenosů

  • Popis výsledku v původním jazyce

    Práce se věnuje problematice analýzy testovatelnosti číslicových obvodů popsaných na úrovni megistrových přenosů. V práci je ukázáno, že je-li každý modul z knihovny modulů tvořících strukturu daného obvodu vybaven kromě <br>informace vztažené k návrhu ivhodnou diagnostickou informací, pak je možno docílit přesnějšího ohodnocení testovatelnosti daného obvodu. K popisu zmíněné informace je využit matematický model založený na tzv. koncepci virtuálních portů. Samotná metoda analýzy testovatelnosti je založena na analýze dvou orientovaných grafů představujících model toku diagnostických dat daným obvodem. Zvlášť je modelován datový tok vzorků a odezev. V závěru práce jsou <br>nastíněny možnosti uplatnění navržené metody v praxi a prezentovány experimentální výsledky dosažené aplikací této metody v několika oblastech souvisejících s automatizací návrhu pro snadnou testovatelnost.

  • Název v anglickém jazyce

    Testability Analysis and Improvements of Register-Transfer Level Digital Circuits

  • Popis výsledku anglicky

    The work deals with problems related to testability analysis method applicable to regis-ter-transfer level digital circuits. It is shown if each module stored in a design library is equipped both with information related to design and information relatedto testing, then more accurate testability results can be achieved. A mathematical model based on so-called virtual port conception is utilized to describe the information and proposed testability analysis method. The method is based on the idea of searching two special digraphs, each of them modeling transfers of diagnostic data within circuit data path. It is important that transfers of vectors and responses are modeled separately. At the end of the work, possible applications of the method in practise are outlined together with experimental results gained by the method in several areas related to automation of design for testability process.

Klasifikace

  • Druh

    B - Odborná kniha

  • CEP obor

    JC - Počítačový hardware a software

  • OECD FORD obor

Návaznosti výsledku

  • Projekt

  • Návaznosti

    Z - Vyzkumny zamer (s odkazem do CEZ)

Ostatní

  • Rok uplatnění

    2008

  • Kód důvěrnosti údajů

    S - Úplné a pravdivé údaje o projektu nepodléhají ochraně podle zvláštních právních předpisů

Údaje specifické pro druh výsledku

  • ISBN

    978-80-214-3599-5

  • Počet stran knihy

    187

  • Název nakladatele

    Fakulta informačních technologií VUT v Brně

  • Místo vydání

    Brno

  • Kód UT WoS knihy